A.2
B.4
C.6
D.8
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A.0
B.1
C.2
D.3
A.主從JK觸發(fā)器
B.主從D觸發(fā)器
C.同步RS觸發(fā)器
D.邊沿D觸發(fā)器
A.1、2、3、4
B.4、3、2、1
C.4、2、3、1
D.4、1、2、3
A.后級(jí)加緩沖電路
B.接入濾波電容
C.修改邏輯設(shè)計(jì)增加冗余項(xiàng)
D.引入封鎖脈沖
A.2
B.3
C.4
D.5
A.譯碼器
B.加法器
C.寄存器
D.數(shù)據(jù)選擇器
A.輸出僅由輸入決定
B.電路的輸出與電路當(dāng)前狀態(tài)無關(guān)
C.電路結(jié)構(gòu)中無反饋環(huán)路
D.有記憶功能
A.全部輸入是0
B.任一輸入是0
C.僅一輸入是0
D.全部輸入是1
A.10101
B.00100101
C.100101
D.10101
A.1
B.2
C.4
D.16
最新試題
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
（）在計(jì)算機(jī)系統(tǒng)中得到了廣泛的應(yīng)用，其中一個(gè)重要用途是構(gòu)成數(shù)據(jù)總線。
用1M×4的DRAM芯片通過（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
一個(gè)兩輸入端的門電路，當(dāng)輸入為10時(shí)，輸出不是1的門電路為（）
一個(gè)16選一的數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有（）個(gè)。