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單項(xiàng)選擇題為了大幅度提高處理器的速度，當(dāng)前處理器中采用了指令并行處理技術(shù)，如超級標(biāo)量（Superscalar），它是指（1）。流水線組織是實(shí)現(xiàn)指令并行的基本技術(shù)，影響流水線連續(xù)流動(dòng)的因素除數(shù)據(jù)相關(guān)性、轉(zhuǎn)移相關(guān)性外，還有（2）和（3）；另外，要發(fā)揮流水線的效率，還必須重點(diǎn)改進(jìn)（4）。在RISC設(shè)計(jì)中，對轉(zhuǎn)移相關(guān)性一般采用（5）方法解決。空白（2）處應(yīng)選擇（）

A.功能部件沖突
B.內(nèi)存與CPU速度不匹配
C.中斷系統(tǒng)
D.訪問指令

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1.單項(xiàng)選擇題為了大幅度提高處理器的速度，當(dāng)前處理器中采用了指令并行處理技術(shù)，如超級標(biāo)量（Superscalar），它是指（1）。流水線組織是實(shí)現(xiàn)指令并行的基本技術(shù)，影響流水線連續(xù)流動(dòng)的因素除數(shù)據(jù)相關(guān)性、轉(zhuǎn)移相關(guān)性外，還有（2）和（3）；另外，要發(fā)揮流水線的效率，還必須重點(diǎn)改進(jìn)（4）。在RISC設(shè)計(jì)中，對轉(zhuǎn)移相關(guān)性一般采用（5）方法解決?？瞻祝?）處應(yīng)選擇（）

A.并行執(zhí)行的多種處理安排在一條指令內(nèi)
B.一個(gè)任務(wù)分配給多個(gè)處理機(jī)并行執(zhí)行
C.采用多個(gè)處理部件多條流水線并行執(zhí)行
D.增加流水線技術(shù)提高并行度

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2.單項(xiàng)選擇題計(jì)算機(jī)執(zhí)行程序所需的時(shí)間P可用P＝I×CPI×T來估計(jì)，其中I是程序經(jīng)編譯后的機(jī)器指令數(shù)，CPI是執(zhí)行每條指令所需的平均機(jī)器周期數(shù)，T為每個(gè)機(jī)器周期的時(shí)間。RISC計(jì)算機(jī)采用（1）來提高機(jī)器的速度。它的指令系統(tǒng)具有（2）的特點(diǎn)。指令控制部件的構(gòu)建，（3）。RISC機(jī)器又通過采用（4）來加快處理器的數(shù)據(jù)處理速度。RISC的指令集使編譯優(yōu)化工作（5）?？瞻祝?）處應(yīng)選擇（）

A.更簡單
B.更復(fù)雜
C.不需要
D.不可能

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3.單項(xiàng)選擇題計(jì)算機(jī)執(zhí)行程序所需的時(shí)間P可用P＝I×CPI×T來估計(jì)，其中I是程序經(jīng)編譯后的機(jī)器指令數(shù)，CPI是執(zhí)行每條指令所需的平均機(jī)器周期數(shù)，T為每個(gè)機(jī)器周期的時(shí)間。RISC計(jì)算機(jī)采用（1）來提高機(jī)器的速度。它的指令系統(tǒng)具有（2）的特點(diǎn)。指令控制部件的構(gòu)建，（3）。RISC機(jī)器又通過采用（4）來加快處理器的數(shù)據(jù)處理速度。RISC的指令集使編譯優(yōu)化工作（5）。空白（4）處應(yīng)選擇（）

A.多尋址方式
B.大容量內(nèi)存
C.大量的寄存器
D.更寬的數(shù)據(jù)總線

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4.單項(xiàng)選擇題計(jì)算機(jī)執(zhí)行程序所需的時(shí)間P可用P＝I×CPI×T來估計(jì)，其中I是程序經(jīng)編譯后的機(jī)器指令數(shù)，CPI是執(zhí)行每條指令所需的平均機(jī)器周期數(shù)，T為每個(gè)機(jī)器周期的時(shí)間。RISC計(jì)算機(jī)采用（1）來提高機(jī)器的速度。它的指令系統(tǒng)具有（2）的特點(diǎn)。指令控制部件的構(gòu)建，（3）。RISC機(jī)器又通過采用（4）來加快處理器的數(shù)據(jù)處理速度。RISC的指令集使編譯優(yōu)化工作（5）?？瞻祝?）處應(yīng)選擇（）

A.CISC更適于采用硬布線控制邏輯，而RISC更適于采用微程序控制
B.CISC更適于采用微程序控制，但RISC更適于采用硬布線控制邏輯
C.CISC和RISC都只采用微程序控制
D.CISC和RISC都只采用硬布線控制邏輯

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5.單項(xiàng)選擇題計(jì)算機(jī)執(zhí)行程序所需的時(shí)間P可用P＝I×CPI×T來估計(jì)，其中I是程序經(jīng)編譯后的機(jī)器指令數(shù)，CPI是執(zhí)行每條指令所需的平均機(jī)器周期數(shù)，T為每個(gè)機(jī)器周期的時(shí)間。RISC計(jì)算機(jī)采用（1）來提高機(jī)器的速度。它的指令系統(tǒng)具有（2）的特點(diǎn)。指令控制部件的構(gòu)建，（3）。RISC機(jī)器又通過采用（4）來加快處理器的數(shù)據(jù)處理速度。RISC的指令集使編譯優(yōu)化工作（5）?？瞻祝?）處應(yīng)選擇（）

A.指令種類少
B.指令種類多
C.指令尋址方式多
D.指令功能復(fù)雜

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6.單項(xiàng)選擇題計(jì)算機(jī)執(zhí)行程序所需的時(shí)間P可用P＝I×CPI×T來估計(jì)，其中I是程序經(jīng)編譯后的機(jī)器指令數(shù)，CPI是執(zhí)行每條指令所需的平均機(jī)器周期數(shù)，T為每個(gè)機(jī)器周期的時(shí)間。RISC計(jì)算機(jī)采用（1）來提高機(jī)器的速度。它的指令系統(tǒng)具有（2）的特點(diǎn)。指令控制部件的構(gòu)建，（3）。RISC機(jī)器又通過采用（4）來加快處理器的數(shù)據(jù)處理速度。RISC的指令集使編譯優(yōu)化工作（5）?？瞻祝?）處應(yīng)選擇（）

A.雖增加CPI，但更減少I
B.雖增加CPI，但更減少T
C.雖增加T，但更減少CPI
D.雖增加I，但更減少CPI

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7.單項(xiàng)選擇題 直接存儲(chǔ)器訪問（DMA）是一種快速傳遞大量數(shù)據(jù)常用的技術(shù)。工作過程大致如下。
①向CPU申請DMA傳送。
②獲CPU允許后，DMA控制器接管（1）的控制權(quán)。
③在DMA控制器的控制下，在存儲(chǔ)器和（2）之間直接進(jìn)行數(shù)據(jù)傳送，在傳送過程中不需要（3）的參與。開始時(shí)需提供要傳送的數(shù)據(jù)的（4）和（5）。
④傳送結(jié)束后，向CPU返回DMA操作完成信號。
空白（5）處應(yīng)選擇（）

A.結(jié)束地址
B.設(shè)備類型
C.數(shù)據(jù)長度
D.數(shù)據(jù)速率

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8.單項(xiàng)選擇題 直接存儲(chǔ)器訪問（DMA）是一種快速傳遞大量數(shù)據(jù)常用的技術(shù)。工作過程大致如下。
①向CPU申請DMA傳送。
②獲CPU允許后，DMA控制器接管（1）的控制權(quán)。
③在DMA控制器的控制下，在存儲(chǔ)器和（2）之間直接進(jìn)行數(shù)據(jù)傳送，在傳送過程中不需要（3）的參與。開始時(shí)需提供要傳送的數(shù)據(jù)的（4）和（5）。
④傳送結(jié)束后，向CPU返回DMA操作完成信號。
空白（4）處應(yīng)選擇（）

A.結(jié)束地址
B.起始地址
C.設(shè)備類型
D.數(shù)據(jù)速率

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9.單項(xiàng)選擇題 直接存儲(chǔ)器訪問（DMA）是一種快速傳遞大量數(shù)據(jù)常用的技術(shù)。工作過程大致如下。
①向CPU申請DMA傳送。
②獲CPU允許后，DMA控制器接管（1）的控制權(quán)。
③在DMA控制器的控制下，在存儲(chǔ)器和（2）之間直接進(jìn)行數(shù)據(jù)傳送，在傳送過程中不需要（3）的參與。開始時(shí)需提供要傳送的數(shù)據(jù)的（4）和（5）。
④傳送結(jié)束后，向CPU返回DMA操作完成信號。
空白（3）處應(yīng)選擇（）

A.外部設(shè)備
B.系統(tǒng)時(shí)鐘
C.系統(tǒng)總線
D.中央處理器

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10.單項(xiàng)選擇題 直接存儲(chǔ)器訪問（DMA）是一種快速傳遞大量數(shù)據(jù)常用的技術(shù)。工作過程大致如下。
①向CPU申請DMA傳送。
②獲CPU允許后，DMA控制器接管（1）的控制權(quán)。
③在DMA控制器的控制下，在存儲(chǔ)器和（2）之間直接進(jìn)行數(shù)據(jù)傳送，在傳送過程中不需要（3）的參與。開始時(shí)需提供要傳送的數(shù)據(jù)的（4）和（5）。
④傳送結(jié)束后，向CPU返回DMA操作完成信號。
空白（2）處應(yīng)選擇（）

A.外部設(shè)備
B.運(yùn)算器
C.緩存
D.中央處理器

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